이더넷 PHY 디바이스에서 대기시간을 개선하기 위한 방법
기관명 | NDSL |
---|---|
출원인 | 아날로그 디바이시즈 글로벌 언리미티드 컴퍼니 |
출원번호 | 10-2018-0140201 |
출원일자 | 2018-11-14 |
공개번호 | 20190530 |
공개일자 | 0000-00-00 |
등록번호 | |
등록일자 | 0000-00-00 |
권리구분 | KUPA |
초록 | 본 개시는 데이터 통신 네트워크들에 관한 것이다. 예시적인 데이터 통신 장치는 트랜시버 회로, 디코더 회로, 및 신호 분석 유닛을 포함하는 물리(PHY) 계층 회로를 포함한다. 트랜시버 회로는 네트워크 링크를 통해 인코딩된 데이터 심볼들을 수신한다. 수신된 인코딩된 데이터 심볼들은 트렐리스 코드화 변조(TCM)를 사용하여 인코딩된다. 디코더 회로는 역-추적 깊이를 사용하여 허용된 심볼 시퀀스에 수신된 심볼 시퀀스를 매핑시키기 위해 최대-우도(ML) 디코딩을 사용하여 수신된 인코딩된 데이터 심볼들을 디코딩한다. 역-추적 깊이 값은 수신된 심볼 시퀀스로부터 허용된 심볼 시퀀스를 식별하기 위해 ML 디코딩에 의해 사용된 수신된 심볼 시퀀스에서의 심볼들의 수이다. 신호 분석 유닛은 네트워크 링크의 하나 이상의 링크 통계들을 결정하며, 하나 이상의 링크 통계들에 따라 역-추적 깊이 값을 설정한다. |
원문URL | http://click.ndsl.kr/servlet/OpenAPIDetailView?keyValue=03553784&target=KUPA&cn=KOR1020180140201 |
첨부파일 |
과학기술표준분류 | |
---|---|
ICT 기술분류 | |
IPC분류체계CODE | H04L-001/00,H04L-029/06 |
주제어 (키워드) |