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특허/실용신안

전계 방출 디스플레이 장치

특허 실용신안 개요

기관명, 출원인, 출원번호, 출원일자, 공개번호, 공개일자, 등록번호, 등록일자, 권리구분, 초록, 원본url, 첨부파일 순으로 구성된 표입니다.
기관명 NDSL
출원인 한국전자통신연구원
출원번호 10-1998-0052018
출원일자 1998-11-30
공개번호 20080509
공개일자 2001-09-06
등록번호 10-0301242-0000
등록일자 2001-06-22
권리구분 KPTN
초록 본 발명은 전계 방출 디스플레이 장치에 관한 것이다. 본 발명에 따른 전계 방출 디스플레이 장치는 서로 평행하게 진공 패키징된 상판과 하판을 구비하는 전계 방출 디스플레이 장치에 있어서, 상기 하판은 절연성 기판상에 형성되는 전계 에미터 어레이와, 상기 전계 에미터 어레이의 에미터 전극과 접속된 드레인을 가진 콘트롤 박막 트랜지스터와, 상기 콘트롤 박막 트랜지스터의 게이트 전극 전극에 접속된 드레인을 가진 어드레싱 박막 트랜지스터로 구성된 픽셀이 행열 형태로 다수개 배열되게 이루어지며, 상기 콘트롤 박막 트랜지스터를 소오스와 게이트 전극간에 큰 기생용량을 가지도록 설계함으로써, 메모리 기능을 갖는 액티브 매트릭스 디스플레이 구동이 가능할 뿐만 아니라 종래의 복잡한 메모리 캐패시터 제작공정을 제거할 수 있어 패널의 제작 공정을 매우 단순화시킬 수 있고 또한 픽셀의 개구율을 크게 증가시킬 수 있다. 또한, 본 발명에서는 기판으로 종래의 단결정 실리콘 웨이퍼 대신에 유리를 사용하기 때문에 대면적의 패널을 값싸게 제조할 수 있을 뿐만 아니라 전계 방출 디스플레이 제작에 필수적인 진공패키징을 용이하게 할 수 있다.
원문URL http://click.ndsl.kr/servlet/OpenAPIDetailView?keyValue=03553784&target=KPTN&cn=KOR1019980052018
첨부파일

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